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Autovision – A Run-time Reconfigurable MPSoC Architecture for Future Driver Assistance Systems (Autovision – Eine zur Laufzeit rekonfigurierbare MPSoC Architektur für zukünftige Fahrerassistenzsysteme)


Author(s): Christopher Claus | Walter Stechele | Andreas Herkersdorf
doi: 10.1524/itit.2007.49.3.181
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  it - Information Technology
 
Print ISSN: 1611-2776
Volume: 49 | Issue: 3
Cover date: May 2007
Page(s): 181-187
 
 
  Keywords
 
driver assistance systems, dynamic partial reconfiguration, real-time video processing
 
  Abstract text

In this article the Autovision architecture is presented, a new Multi Processor System-on-Chip (MPSoC) architecture for future video-based driver assistance systems, using run-time reconfigurable hardware accelerator engines for video processing. According to various driving conditions (highway, city, sunlight, rain, tunnel entrance) different algorithms have to be used for video processing. These different algorithms require different hardware accelerator engines, which are loaded into the Autovision chip at run-time of the system, triggered by changing driving conditions. It was investigated how to use dynamic partial reconfiguration to load and operate the correct hardware accelerator engines in time, while removing unused engines in order to save precious chip area.

In diesem Artikel wird die Autovisionarchitektur vorgestellt, eine neue Multi-Prozessor System-on-Chip (MPCoC) Architektur für zukünftige video-basierte Fahrerassistenzsysteme, die Hardwarebeschleuniger für die Videoverarbeitung verwendet, die zur Laufzeit austauschbar sind. Gemäß dem sich verändernden Fahrumfeld (Autobahn, Innenstadt, Sonnenlicht, Regen, Tunneleinfahrt) müssen unterschiedliche Algorithmen für die Videoverarbeitung verwendet werden. Diese unterschiedlichen Algorithmen bedürfen verschiedener Hardwarebeschleuniger-Engines, die zur Laufzeit des Systems abhängig von den sich verändernden Fahrzuständen in den Autovisionchip geladen werden. Es wurde untersucht, wie man die dynamisch partielle Rekonfiguration dazu verwenden kann, die richtigen Hardwarebeschleuniger-Engines rechtzeitig zu laden und anzusteuern, während unbenutzte Engines vom FPGA entfernt werden, um wertvolle Chipfläche einzusparen.